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商品描述
在H.264/AVC視頻編碼器系統芯片的設計過程中，整個運動估計（Motion Estimation, ME）部分將決定著整個編碼器的實時編碼性能。整數像素運動估計（IME）模塊主要完成多參考幀、大範圍、粗精度的幀間匹配搜索；它可以採用快速搜索算法和高度的並行處理結構來滿足編碼器的實時運算需求；而對於分數像素運動估計（FME）模塊，它是在整數像素運動估計的基礎上，再對宏塊的41×n個（n個參考幀）分割子塊進行小範圍、率失真優化（RDO）控制下、更高精度的1/2像素和1/4像素匹配搜索，並且還要根據41×n個分割子塊的分數像素匹配搜索結果，完成宏塊的最終編碼模式的選取；以及宏塊的幀間運動補償。 因此，書中針對H.264/AVC的幀間編碼算法和具體的編碼系統設計需求，提出了分數像素運動估計（FME）基於流水的VLSI設計結構。再通過分析完成了整個FME模塊的細致層次劃分；同時，也依據面積與速度的平衡互換設計原則，對FME編碼算法進行了適當的優化調整；完成了FME各個子模塊的VLSI結構設計和相應的Verilog HDL代碼編寫和調試。最後在Altera公司的DE2開發板（Cyclone® II EP2C35F672C6 FPGA）上進行了FME模塊的VLSI設計驗證，驗證的結果也表明瞭本設計的可行性。
