基於Quartus Prime的數字系統Verilog HDL設計實例詳解（第3版） 基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)
周潤景
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商品描述
本書以語法與實例結合的方式來講解可編程邏輯器件的設計方法，軟件開發平臺為Altera公司的Quartus Prime 16.1 FPGA/CPLD設計軟件。本書由淺入深地介紹了利用Quartus Prime進行數字系統開發的設計流程、設計思想和設計技巧。書中的例子非常豐富，既有簡單的數字邏輯電路實例，也有復雜的數字系統設計實例。
