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商品描述
<內容簡介>
System-on-a-chip (SoC) has become an essential technique to lower product costs and maximize power efficiency, particularly as the mobility and size requirements of electronics continues to grow. It has therefore become increasingly important for electrical engineers to develop a strong understanding of the key stages of hardware description language (HDL) design flow based on cell-based libraries or field-programmable gate array (FPGA) devices. Honed and revised through years of classroom use, Lin focuses on developing, verifying, and synthesizing designs of practical digital systems using the most widely used hardware description Language: Verilog HDL.
<章節目錄>
Chapter 1: Introduction.
Chapter 2: Structural Modeling.
Chapter 3: Dataflow Modeling.
Chapter 4: Behavioral Modeling.
Chapter 5: Tasks, Functions, and UDPs.
Chapter 6: Hierarchical Structural Modeling.
Chapter 7: Advanced Modeling Techniques.
Chapter 8: Combinational Logic Modules.
Chapter 9: Sequential Logic Modules.
Chapter 10: Design Options of Digital Systems.
Chapter 11: System Design Methodology.
Chapter 12: Synthesis.
Chapter 13: Verification.
Chapter 14: Arithmetic Modules.
Chapter 15: Design Examples.
Chapter 16: Design for Testability.
商品描述(中文翻譯)
<內容簡介>
系統單晶片（System-on-a-chip, SoC）已成為降低產品成本和最大化功率效率的關鍵技術，特別是在電子產品的移動性和尺寸需求不斷增長的情況下。因此，對於電機工程師來說，深入了解基於單元庫或現場可編程閘陣列（FPGA）設備的硬體描述語言（HDL）設計流程的關鍵階段變得越來越重要。林教授經過多年課堂使用的磨練和修訂，專注於使用最廣泛使用的硬體描述語言：Verilog HDL，來開發、驗證和綜合實用數位系統的設計。
<章節目錄>
第1章：介紹。
第2章：結構建模。
第3章：資料流建模。
第4章：行為建模。
第5章：任務、函數和UDP。
第6章：階層結構建模。
第7章：進階建模技術。
第8章：組合邏輯模組。
第9章：序列邏輯模組。
第10章：數位系統的設計選項。
第11章：系統設計方法論。
第12章：綜合。
第13章：驗證。
第14章：算術模組。
第15章：設計範例。
第16章：可測試性設計。
